質問編集履歴
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内容の修正
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VivadoHLSを用いて高位合成をしています。
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Cのシュミレーションと合成は通ったのですが,RTLのシュミレーションを実行しても一向に終わりません.
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Cのシュミレーションと合成は通ったのですが,RTL(Verilog)のシュミレーションを実行しても一向に終わりません.
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画像のようなところから全く進みません。
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解決策が分かるかたは教えてください。
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よろしくお願いします。
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原因として何が考えられますか?
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分かる方は教えてください.
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書式の改善
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Cのシュミレーションと合成は通ったのですが,RTLのシュミレーションを実行しても一向に終わりません.
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画像のようなところから全く進みません。
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解決策が分かるかたは教えてください。
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よろしくお願いします。
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![イメージ説明](c5afb710632b5f0fdb9b2f17ae880369.jpeg)
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よろしくお願いします.
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